芯片行业正在经历一场静默的范式转移。性能提升不再靠晶体管密度单打独斗，先进封装——2.5D、3D-IC、芯粒、异构集成——成了新的主战场。这些架构是AI和高性能计算的刚需，但也把供电问题推到了系统设计的核心位置。

变化最剧烈的不是规模，而是连接密度：更多裸片、更多供电域、更多垂直互连、更高的电流密度。这迫使行业重新思考供电完整性（PI）——从局部问题变成系统级学科。

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传统2D芯片的供电网络基本是平面的，电流横向流动，噪声行为相对局部化。3D-IC则完全不同：垂直堆叠的供电路径横跨多个裸片、硅中介层、微凸点、硅通孔（TSV）和封装基板。这种架构带来了三类新挑战。

第一，非局部效应。AI负载需要瞬时大电流，电压裕量却在不断收紧。一处的供电扰动会影响另一处的时序、信号完整性和可靠性。供电问题不再是"每颗裸片自己的事"，而是三维尺度的系统问题。

第二，密度带来的失效模式。现代系统可能有数万个微凸点、密集的TSV阵列、快速增长的VDD和VSS连接。这暴露了新的风险：微凸点电迁移、TSV热机械应力、供电网络与信号网络耦合、封装级电压塌陷。AI/ML系统的负载特性让问题更棘手——突发计算、加速器唤醒、快速电流瞬变，最坏情况难以用静态或近似模型预测。

第三，电热耦合。TSV和硅中介层不再只是配角，它们同时承担供电和散热职能。当TSV数量达到数万级、中介层电流密度持续攀升，电迁移、焦耳热、热梯度诱发的机械应力同时出现。电驱动温度，温度又改变电特性——3D-IC的供电完整性本质上是电热问题，不是纯电气问题。

电压裕量持续收窄的背景下，供电精度直接决定性能、良率和上市时间。这解释了为什么EDA工具、代工厂和系统厂商都在重新投资供电分析——不是锦上添花，是生死线。